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第一个7纳米人工智能芯片准备就绪

[电线电缆网]Wave Computing的目标是成为第一家开发7纳米处理器并将其部署到人工智能系统中的人工智能初创公司。

据《EE Times》目前掌握的消息,波计算的7纳米发展计划将采用博通公司的专用集成电路芯片设计。Wave和Broadcom将使用TSMC的7纳米技术开发Wave的下一代数据流处理单元。DPU).

新的7纳米DPU将由博通公司提供,但时间表还不确定。根据Wave首席执行官德里克迈耶的说法,7纳米DPU将“在我们自己的人工智能系统中设计”他补充道,“如果市场上的其他公司有这种需求,他们也可以提供通信芯片。”

市场研究公司Tirias Research的首席分析师凯文克瑞韦尔(Kevin Krewell)透露,“Wave希望凭借这款7纳米设计在初创企业中脱颖而出。目前,大多数初创公司不具备制造7纳米组件的专业技能和能力。”他指出,在博通的帮助下,这一切成为可能。他指出,博通“因为收购了大规模集成电路逻辑,所以拥有更先进的专用集成电路设计经验。”

波的当前DPU一代是基于16纳米工艺的设计。

“在博通的帮助下,我们将率先设计具有7纳米物理知识产权的新型人工智能加速器,如56千兆位/秒和112千兆位/秒服务器。”迈耶指出,博通带来了先进的设计平台、大规模生产技术和成熟的7纳米知识产权,帮助我们实现这一7纳米产品开发计划。

目前一代的DPU波是基于16纳米的过程节点,这主要是由波自己的设计师和承包商完成。至于7纳米DPU,迈耶暗示,“在博通和Wave之间,我们已经找到了设计ASIC前端和后端所需的技能和资源,并相应地找到了合作设计。”

目前,这一7纳米合作项目已经开放,并已进行了几个月。Broadcom将负责7纳米芯片的物理部分。尽管7纳米设计很复杂,迈耶透露,“我相信博通将首次推出合适的芯片。”然而,Wave没有透露其7纳米DPU何时上市,也没有对7纳米DPU架构给出更多解释。

7纳米DPU内部披露

然而,迈耶指出,新芯片将“以数据流架构为根”这将是第一个拥有64位多线程处理器的DPU。今年6月,Wave收购了MIPS。

迈耶还指出,Wave的7纳米芯片将在内存中携带新功能,但他没有透露增加了哪些新功能。

然而,迈耶表明,MIPS的多线程技术将在新一代DPU中发挥关键作用。通过Wave的数据流处理,“当我们为机械学习代理加载、卸载和重新加载数据时,硬件多线程架构将非常高效。”此外,MIPS的缓存一致性也将是Wave新DPU的另一个主要特点。他说,“因为我们的DPU是一个64位的体系结构,所以只有MIPS和DPU在64位地址空间中与通信存储器通信才有意义。”

至于Wave将添加到其内存中的新功能,Krewell说,“Wave现有的芯片使用了Micron的混合内存立方体;HMC).我认为Wave未来的芯片将转向高带宽存储器他补充道:“哈佛商学院有更好的未来发展蓝图。不断变化的内存体系结构将影响整个系统框架。”

摩尔洞察战略高级分析师卡尔芬对此表示赞同。他说:“对于内存部分,我想他们会放弃有内存的立方体,采用高带宽内存,因为这种方法更具成本效益。”

迈耶在收购采访中主张,新的7纳米DPU预计将提供比现有芯片高10倍的功能。

他说,“别忘了,我们已经将DPU架构中的频率与芯片分离了。”他指出,在主机之间来回移动会造成瓶颈,而在DPU,嵌入式微控制器可以加载指令,以减少传统加速器浪费的功率和延迟。"我们可以有效地利用7纳米芯片上的晶体管能力来提高功能."

然而,克瑞威尔对此有所保留。他说:“至于波能否在功能上实现10倍的进步,这是否是一个漫长的旅程取决于如何衡量机械学习的功能.德里克是在谈论实践还是推理。”他补充道,“在推理方面有许多变化,这些变化也是以较低精度(8位或更低)的算法来安排的。练习的功能主要取决于内存架构。”此外,他还承认,“我真的不知道波的战略细节。”

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